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AD9268型號表：AD9268BCPZ-801 AD9268BCPZRL7-801 AD9268BCPZ-105 AD9268BCPZRL7-105 AD9268BCPZ-125 AD9268BCPZRL7-125 AD9268-80EBZ AD9268-105EBZ AD9268-125EBZ

SC1269可兼容替代AD9268

SC1269  是一款雙通道  16  位，最高轉(zhuǎn)換速度  125MSps，基于流水線架構(gòu)的模數(shù)轉(zhuǎn)換器（ADC），內(nèi)部集成了時(shí)鐘緩沖、基準(zhǔn)電壓源、輸入采樣保持等功能模塊，實(shí)現(xiàn)對模擬輸入高速高精度模數(shù)轉(zhuǎn)換。并集成了獨(dú)特的數(shù)字校準(zhǔn)

算法，在不影響功耗的前提下，有效提升ADC 動(dòng)態(tài)特性。輸出為  1.8V  全并行  CMOS  電平，采用三線制  SPI  串行接口實(shí)現(xiàn)內(nèi)部寄存器的讀寫操作。SC1269 采用  64 腳  QFN 封裝，  額定溫度范圍-40℃至 85℃工業(yè)溫度范圍。 

主要性能
?  1.8V  模擬電源供電
?  1.8V CMOS  輸出供電
?  低功耗：750mW（125MSps）
?  信噪比(SNR) : 78dBFS(70MHz, 125MSps)
?  無雜散動(dòng)態(tài)范圍(SFDR) : 88dBc(70MHz, 
125MSps)
?  中頻采樣頻率達(dá) 400MHz  以上
?  小信號輸入噪聲: -154.0dBm/Hz(200Ω輸入阻
抗，70MHz，125MSps)
?  可編程  ADC  內(nèi)部基準(zhǔn)電壓源
?  集成   ADC  采樣保持輸入
?  靈活的模擬輸入范圍：1Vpp  至   2Vpp
?  差分模擬輸入 650MHz  帶寬
?  ADC  時(shí)鐘占空比穩(wěn)定器
?  串行端口控制
?  QFN-64  封裝   9mm x 9mm
應(yīng)用場合
?  通信
?  分集無線電系統(tǒng)
?  多模式數(shù)字接收器(3G)
GSM、EDGE、W-CDMA、LTE、
CDMA2000、WiMAX、TD-SCDMA
?  I/Q  解調(diào)系統(tǒng)
?  智能天線系統(tǒng)
?  通用軟件無線電
?  寬帶數(shù)據(jù)應(yīng)用

?  超聲設(shè)備

典型應(yīng)用電路
SC1269 輸入信號、輸入時(shí)鐘、外部直流引腳等外圍器件的典型應(yīng)用電路如下。
模擬輸入網(wǎng)絡(luò)
當(dāng)輸入頻率處于第二或更高奈奎斯特區(qū)域時(shí)，大多數(shù)放大器的噪聲性能無法滿足要求以達(dá)到SC1269 真正的  SNR 性能。建議使用的輸入配置是差分雙巴倫耦合（見圖  15）。在這種配置中， 輸入交流耦合，這些電阻補(bǔ)償輸入巴倫的損耗，向驅(qū)動(dòng)器提供 50Ω阻抗。在雙巴倫和變壓器配置中，輸入電容和電阻的值取決于輸入頻率和源阻抗，并且可能需要降低或去掉。表 7 列出了設(shè)置RC 網(wǎng)絡(luò)的建議值。當(dāng)輸入頻率較高時(shí)，將鐵氧體磁珠與電阻串聯(lián)并去掉電容可以實(shí)現(xiàn)良好的性能。不過，這些值取決于輸入信號，且只能用作初始參考。

時(shí)鐘輸入網(wǎng)絡(luò)
為充分發(fā)揮芯片的性能，應(yīng)利用一個(gè)差分信號作為  SC1269  采樣時(shí)鐘輸入端（CLK+/-）的時(shí)鐘信號。輸入時(shí)鐘引腳有內(nèi)部偏置，無需外部偏置。如果這些輸入懸空，建議將  CLK-引腳拉低以防止雜散時(shí)鐘。建議采樣射頻變壓器配置，如圖  16  所示。跨接在變壓器上的背對背肖特基二極管可以將輸入到  SC1269  中的時(shí)鐘信號限制為約差分  0.8V  峰峰值。這樣，既可以防止時(shí)鐘的大電壓擺幅饋通至其它部分，還可以保留信號的快速上升和下降時(shí)間，這一點(diǎn)對低抖動(dòng)性能來說非常重要。