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SC9268 即AD9268國產替代型號，是一款雙通道 16 位，最高轉換速度 125MSps，基于流水線架構的模數轉換器（ADC），內部集成了時鐘緩沖、基準電壓源、輸入采樣保持等功能模塊，實現對模擬輸入高速高精度模數轉換。并集成了獨特的數字校準算法，在不影響功耗的前提下，有效提升ADC動態(tài)特性。輸出為 1.8V 全并行 CMOS 電平，采用三線制 SPI 串行接口實現內部寄存器的讀寫操作。SC9268 采用 64 腳 QFN 封裝， 額定溫度范圍-40℃至 85℃工業(yè)溫度范圍。

主要性能
? 1.8V模擬電源供電
? 1.8V CMOS輸出供電
? 低功耗：750mW（125MSps）
? 信噪比(SNR) : 78dBFS(70MHz, 125MSps)
? 無雜散動態(tài)范圍(SFDR) : 88dBc(70MHz,
125MSps)
? 中頻采樣頻率達 400MHz以上
? 小信號輸入噪聲: -154.0dBm/Hz(200Ω輸入阻
抗，70MHz，125MSps)
? 可編程 ADC內部基準電壓源
? 集成 ADC采樣保持輸入
? 靈活的模擬輸入范圍：1Vpp至 2Vpp
? 差分模擬輸入 650MHz帶寬
? ADC時鐘占空比穩(wěn)定器
? 串行端口控制
? QFN-64封裝 9mm x 9mm
應用場合
? 通信
? 分集無線電系統(tǒng)
? 多模式數字接收器(3G)
GSM、EDGE、W-CDMA、LTE、
CDMA2000、WiMAX、TD-SCDMA
? I/Q解調系統(tǒng)
? 智能天線系統(tǒng)
? 通用軟件無線電
? 寬帶數據應用
? 超聲設備

應用信息
電源和接地建議
建議使用兩個獨立的 1.8 V電源為 SC9268供電：一個用于模擬端 AVDD，一個用于數字輸出端DRVDD。對于 AVDD和 DRVDD，應使用多個不同的去耦電容以支持高頻和低頻。去耦電容應放置在接近 PCB入口點和接近器件引腳的位置，并盡可能縮短走線長度。SC9268僅需要一個 PCB接地層。
對 PCB模擬、數字和時鐘模塊進行合理的去耦和巧妙的分隔，可以輕松獲得最佳的性能。裸露焊盤散熱塊建議為獲得最佳的電氣性能和熱性能，必須將 ADC底部的裸露焊盤連接至模擬地 AGND。PCB上裸露的連續(xù)銅平面應與 SC9268的裸露焊盤匹配。銅平面上應有多個通孔，以便獲得盡可能低的熱阻路徑以通過 PCB底部進行散熱。應當填充或堵塞這些通孔，防止通孔滲錫而影響連接性能。為了最大化地實現 ADC與 PCB之間的覆蓋與連接，應在 PCB上覆蓋一個絲印層，以便將 PCB上的連續(xù)平面劃分為多個均等的部分。這樣，在回流焊過程中，可在 ADC與 PCB之間提供多個連接點。而一個
連續(xù)的、無分割的平面則僅可保證在 ADC與 PCB之間有一個連接點。
VCM
VCM引腳應通過一個 0.1uF電容去耦至地。
RBIAS
SC9268要求用戶將一 10 kΩ電阻置于 RBIAS引腳與地之間。該電阻用來設置 ADC內核的主基準電流，該電阻容差至少為 1%。
基準電壓源去耦
VREF引腳應通過外部一個低 ESR 0.1uF陶瓷電容和一個低 ESR 1.0uF電容的并聯(lián)去耦至地。
SPI端口
當需要轉換器充分發(fā)揮其全動態(tài)性能時，應禁用 SPI端口。通常 SCLK信號、CSB信號和 SDIO信號與 ADC時鐘是異步的，因此，這些信號中的噪聲會降低轉換器性能。如果其它器件使用板上SPI總線，則可能需要在該總線與 SC9268之間連接緩沖器，以防止這些信號在關鍵的采樣周期內，在轉換器的輸入端發(fā)生變化。

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